1. CMOS Processing Flow and Layout Design Rules 2. Layout Styles of MOS Transistors 3. Layout Styles of Resistors, Capacitors, and Inductors 4. Standard Cell Library Layout 5. Layout of Latch-Up and ESD 6. Analog Layout Considerations 7. Power Distribution and Signal-Integrity of Mixed-Signal IC 8. Floor Planning of Mixed-Signal IC 9. Noise Sources and Analysis of Mixed-Signal IC 10. Noise Reduction Techniques of Mixed-Signal IC
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课程大纲
2. Layout Styles of MOS Transistors
3. Layout Styles of Resistors, Capacitors, and Inductors
4. Standard Cell Library Layout
5. Layout of Latch-Up and ESD
6. Analog Layout Considerations
7. Power Distribution and Signal-Integrity of Mixed-Signal IC
8. Floor Planning of Mixed-Signal IC
9. Noise Sources and Analysis of Mixed-Signal IC
10. Noise Reduction Techniques of Mixed-Signal IC
培训师介绍
中国台湾交通大学电子研究所博士
经验:
中国台北大学电机研究所副教授
中国台湾工业研究院计算机与通讯研究所
中国台湾辅仁大学电子工程学系
中国台湾工研院系统芯片技术中心顾问
中国台湾工研院电通所集成电路设计部,开发cell library,
至美国德州仪器(TI, Texas, U.S.A.),合作开发Multimedia
专精:
数字模拟混合集成电路设计、低功率与高速集成电路与系统设计
授课经验:
曾在台积电、盛群科技、立
本课程名称: 混合信号式集成电路布局
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